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FPGA 用Verilog HDL實現三角波,三相方波程序

FPGA——用Verilog HDL進行三角波和

三相方波的編寫

三角波

module triangle(

inputsys_clk,

output [2:0]sda

);

reg[3:0]a=0;

regai=0;

[email protected](posedgesys_clk)

begin

if(ai==0)

begin

a=a+1;

if(a==7)

ai<=1;

end

else

begin

a=a-1;

if(a==0)

ai<=0;

end

end

assignsda[0]=a[0];

assignsda[1]=a[1];

assignsda[2]=a[2];

endmodule

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